目前数字示波器多采用DSP、内嵌微处理器型FPGA或微处理器+FPGA架构。虽然内嵌微处理器型FPGA灵活性强，可以充分进行设计开发和验证，便于系统升级且FPGA外围电路简单。但是该类型FPGA属于高端FPGA，价高且供货渠道难得，不适合低成本的数字示波器使用。若单独使用DSP，虽然其数据处理能力强大，运行速度较高，但DSP的控制能力不突出，且数字示波器的采样率越来越高，DSP内部不能做数据流降速和缓存，当设计采用高实时采样率的 ADC，就得选用频率更高且内部存储资源更丰富的DSP，而此类DSP一般都价格昂贵，同样不适合低成本的数字示波器使用。因此，微处理器+FPGA架构的方案是本设计首选。微处理器+FPGA架构的数字示波器的系统结构图